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編碼器“參數化”的方法

時間:2018-10-23 15:04:35來源:網絡

導語:?由于該設計是可參數化的,所謂“參數化”就是通過設置輸入數據的位寬就能實現(xiàn)相應數據位寬的編碼器。假設編碼器的輸入數據位寬為A,輸出數據位寬為B,由我們所學的數電知識可知其關系為B=log2(A),其中l(wèi)og2(x)是以2為底的對數函數。而VerilogHDL中有與其對應的系統(tǒng)函數:$clog2(x)。

由于該設計是可參數化的,所謂“參數化”就是通過設置輸入數據的位寬就能實現(xiàn)相應數據位寬的編碼器。假設編碼器的輸入數據位寬為A,輸出數據位寬為B,由我們所學的數電知識可知其關系為B=log2(A),其中l(wèi)og2(x)是以2為底的對數函數。而VerilogHDL中有與其對應的系統(tǒng)函數:$clog2(x)。

實現(xiàn)該編碼器的方法:第一,通過遍歷數據位的方法;第二,通過推導公式的方法。

<1>通過遍歷數據位的方法有兩種,都是借助for循環(huán)來實現(xiàn)的。第一種方法是從輸入數據的低位向高位遍歷,并判斷遍歷到的數據位是否為1,若為1,則其對應的二進制碼就是編碼器的輸出。另一種方法是從輸入數據的高位向低位遍歷,并判斷遍歷到的數據位是否為1,若為1,則其對應的二進制碼就是編碼器的輸出。

<2>通過推導公式的方法。下面是8-3編碼器的輸入輸出對應關系:

再總結下上述公式,編碼器輸出的某個位可由可能導致該位為1的輸入位進行或運算的結果決定,如編碼器輸入din中所有二進制索引號第0位為1的位進行或運算,便得到編碼器輸出第0位dout[0];編碼器輸入din中所有二進制索引號第1位為1的位進行或運算,便得到編碼器輸出第1位dout[1];依次類推。

在設計中,利用兩個for循環(huán)實現(xiàn),一個for用于對編碼器輸入的索引號進行計數,另一個for用于對編碼器輸出的索引號進行計數。同時還要判斷輸入二進制索引號對應位以進行相應的或運算。

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